Text preview for : j618tas.pdf part of some brands - algumas marcas some schematic motherboards notebooks downloaded from www.freeservicemanuals.net. alguns esquemas placa-mae e notebook baixados de www.freeservicemanuals.net.



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J618TAS
55)





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VCMOS Decoupling


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DO NOT STUFF Place site w/ in 0.5" of clock pin(W37)

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8+ 8+ 8+ 2 8+ 8+
8: 33 GTLREF Generation Circuit 8: Use 0603 Packages and distribute within 500mils of Mendocino GTLREF Inputs(1 cap for every 2 inputs).


JS2 ON OFF OFF OFF

JS3 OFF 2-3 2-3 1-2

JS4 OFF (66/100,100/100,133/100) 2-3 1-2 1-2

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ON OFF OFF OFF

AF36: TUALATIN AF36 NC COPPERMINE AF36 GND


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FOR CPU VTT






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8+



FREQUENCY

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JS3 FS4



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3$ 8:

5 2

55

8+

3



82BC PLACE SITE WITHIN 0.5" OF CLOCK BALL(V6)

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B




B

Host Freq:Hi=100,Low=66 2 $ 5) B4

FSB P-MOS kiker Hi=Non-Cu,low=Cu B
$ B



DIMM2



B7
8829



DIMM3
B)67
889

2 $ 2 $


2 3
2 3

$ 3 B

Host Freq:Hi=133,low=100/66

B)6 B)6 B)6$ B)6 B)62 B)63 B)6 B)6
B7889 B73889 B B B B B$ B B2 B3 B B B$ B B2 B3

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B

B

B73889

SM/LM muxing strap,active low




B73889

B B B B B B$ B B2 B3

5)




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XOR chain:NC=XOR,LOW=NORMAL

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533 $ 53 $3 53
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Use surface mount caps placed close as possible to power pins with short, wide direct connections.





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RCLK=3.25"~3.75" Place R93 within 0.5" of the GMCH Ball. $$ @$$<

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3 34 $ 2 3 5))6

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If AGP intergace < 6 at least 1:3 trace spacing (data and data) & (strobes and strobes). But data and strobes muse 1:4 2X/4X signals muse be matched their associated strobe within +/- 0.5 inches.

$

6 $
$ $

) EXAMPLE: AD_STB0 & AD_STB0# is 5.3 long. AD[15:0] & C/BE[1:0] can be 4.8 to 5.8 long. +/- 0.5

Strobe signals: AD_STB0,AD_STB0#,AD_STB1,AD_STB1# SB_STB,SB_STB#


EXAMPLE $4 C $23 $ C $ $ C SB_STB & SB_STB# is 4.2 SBA[7:0] can be 3.7 to 4.7 long.



The strobe pair must be length matched to less than +/- 0.1 $4 3< %&' %(


DATA AD[15:0],C/BE[1:0]# AD[31:16],C/BE[3:2]# SBA[7:0]

Strobe in 2X AD_STB0 AD_STB1 SB_STB

Strobe in 4X AD_STB0,AD_STB0# AD_STB1,AD_STB1# SB_STB,SB_STB#

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FOR COM2

PRT PORT


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2 4 6 8 10 12 14 16

POWER LED

TURBO S/W


IDELED

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SMI S/W

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GPO21 0 1 1 1 0
5

GPO22 0 0 1 1 1 0 1 0

GPO23 0 0 0 1 1 1 0 1

VCC3 3.314V


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3.50V 3.633V 3.418V 3.529V 3.298V

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GAME PORT/AUX IN INTERFACE

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PC SPEAK IN INTERFACE
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MICROPHONE IN INTERFACE (Option)
** Please see the application note. (APN-M01A)

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ON-MAIN BOARD FUNCTION : EXTERNAL BIOS ROM SIZE



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Mount R389 External Clock Enable Mount R391 External Clock Disable





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PDC20265 RAID 0 MOUNT RX1 RX2 RX4 RX5 REMOVE RX3 RX6

PDC20265 RAID 0 OR 1 MOUNT RX1 RX3 RX5 RX6 REMOVE RX2 RX4

PDC20267 RAID 0,0+1,1 MOUNT RX3 RX6 REMOVE RX1 RX2 RX4 RX5

34 $0 4 7 7 >
* >$ * > *C =0 )#+

C449,C407:1UF

C449,C407:1UF

C449,C407:4.7K

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REMOVE RX1~RX2 and BC9,BC11 Change to 4.7K ohm FOR PDC20267 MOUNT RX1~RX2 FOR PDC20265

PDC20265/20267 WITH OSC


>> 1

MOUNT OSC & USD_A2 PULL HI REMOVE R450 & R453

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7 >

71<

= 4 => 4

7 >



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PDC20265/20267 WITHOUT OSC MOUNT R450 & R453 REMOVE OSC & USD_A2 PULL LO

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